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利用高层次综合技术快速实现复杂DSP算法

本文以FIR的实现为例，利用Catapult Synthesis快速探索不同的设计架构，快速地找到性能、面积和功耗之间折衷的最佳实现方案，使得真正的IP复用成为可能，并以图表方式给出不同约束下的面积、延迟和吞吐率(36、3、1 时钟周期)的性能，同时提供了集成的验证和综合流程，极大地提高了设计效率。

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