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适用于DCS1800基站的PLL合成器的设计

该频率合成器的设计包括了相位-频率比较器及位于其后的电荷泵、环路滤波器、VCO和分频器。电荷泵将鉴频鉴相器的逻辑状态转换为适合于控制VCO的模拟信号。在其关闭状态，电荷泵和合成器的输入部分必须表现出非常低的漏电流，否则在相位比较器之间的环路滤波器上将会出现电压合成。

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