采用创新降耗技术应对FPGA静态和动态功耗的挑战
采用可编程电源技术,根据特定逻辑路径所需的是高速还是低速逻辑,通过提供高速或低速逻辑的方法,可对Stratix III的逻辑构造在逻辑阵列块(LAB)级进行编程。基于这种思路,选出所占比例很小的对时序有苛刻要求的电路进行高速设定,而剩下的实行低功耗设定,采用这种方法,可将低功耗逻辑的漏电功耗降低70%。将不使用的逻辑、以及DSP块和TriMatrix存储器设定为低功耗模式将进一步降低功耗。
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